A mikroelektronikai technológia kihívásai

Slides:



Advertisements
Hasonló előadás
Szén nanocsövek STM leképezésének elméleti vizsgálata
Advertisements

A MINŐSÉG MEGTERVEZÉSE
2004. április 29.1 A földfelszíni digitális televíziózás (DVB-T) frekvenciagazdálkodási kérdései A digitális televíziózás dr. Kissné Akli Mária Okleveles.
IP vagy Analóg Videó Megfigyelő rendszer
Nyomtatott huzalozású szerelőlemezek mechanikai viselkedésének vizsgálata Készítette: Fehérvári Péter Konzulens: Dr. Sinkovics Bálint.
Vékonyréteg Si napelemek, technológia fejlesztési irányok.
Digitális elektronika
A tervezés mint menedzsment funkció
Szélessávú jelfeldolgozás kihívásai Készítette : Fürjes János.
Michael E. Porter Berencsi Balázs GTK – GM ARFWIM
Az integrált áramkörök (IC-k) tervezése
Az integrált áramkörökben (IC-kben) használatos alapáramkörök
Készítette: Fehérvári Péter Konzulens: Hajdu István
Energiaellátás: Tárolás
Budapest University of Technology and Economics Elektronikus Eszközök Tanszéke mikofluidika.eet.bme.hu Nagy átbocsátóképességű nanokalorimetriás Lab-on-a-Chip.
A térvezérelt tranzisztorok I.
MOS integrált áramkörök alkatelemei
VLSI áramkörök Gyártástechnológiai újítások Készítette: Borbíró Péter Czett Andor.
Az integrált áramkörök (IC-k) gyártása
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke 1. zárthelyi megoldásai október 18.
CMOS technológia a nanométeres tartományban
JOSEPHSON QUBITEK Josephson effektus dióhéjban
4. Előadás Vállalatgazdálkodási alapok
MIKROELEKTRONIKA 6. A p-n átmenet kialakítása, típusai és alkalmazásai
A MEMÓRIA.
Kovalens kötés a szilícium-kristályrácsban
Speciális tranzisztorok, FET, Hőmodell
Memóriák.
Digitális rendszerek I. c
A CAD/CAM modellezés alapjai
Megvalósíthatóság és költségelemzés Készítette: Horváth László Kádár Zsolt.
Elektromágneses hullámok
III. A logisztika jövője
IC-k számítógépes tervezése Budapesti Mûszaki Egyetem Elektronikus Eszközök Tanszéke 1999 november.
Mikroelektronikaéstechnológia Bevezetõ elõadás Villamosmérnöki Szak, III. Évfolyam.
A szervezeti felépítés definíciója
Szoftvercentrum Workshop ME. Mechanikai Technológiai Tanszék ESETTANULMÁNYOK A SZIMULÁCIÓ ALKALMAZÁSÁRA A MECHANIKAI TECHNOLÓGIÁKBAN Esettanulmányok.
A KTI az EU és a hazai közlekedéspolitika irányelveit követve a fenntartható fejlődés szempontjait figyelembe véve folyamatosan fejlődő,
Móra Ferenc Gimnázium (Kiskunfélegyháza)
ZnO réteg adalékolása napelemkontaktus céljára
Uránszennyezés a Mecsekben
Félvezető memóriák Elektronikus Eszközök Tanszéke
Maszkkészítés Planár technológia Kvázi-sík felületen
RF MEMS Microrelays Készítette: Bognár György 2003 május 6. VLSI előadás Budapesti Műszaki és Gazdaságtudományi Egyetem.
MIKROELEKTRONIKA, VIEEA306
Bipoláris technológia Mizsei János Hodossy Sándor BME-EET
Integrált áramkörök tesztelése (minőségellenőrzés)
Cim Design flow, production flow, maszkok, technológia Tervezési szabályok, lambda. Pálcika diagram, alap layoutok Layout tervezés, P&R.
Berendezés-orientált IC-k BME Villamosmérnöki és Informatikai Kar Elektronikus Eszközök Tanszéke Székely Vladimír, Mizsei János 2004 április BME Villamosmérnöki.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA306 MOS áramkörök: CMOS áramkörök,
MIKROELEKTRONIKA, VIEEA306
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke 2. zárthelyi megoldásai december 2.
Ipari Katasztrófák3. előadás1 A technika. Ipari Katasztrófák3. előadás2 A technológia kialakulása 1.Alapkutatás: a természettudományos össze- függések.
Autonómia Alapítvány projektfejlesztő programja a Nyílt Társadalom Intézet Alapítvány (OSI) „EU forrásokkal a romák integrációjáért” nemzetközi program.
Lesz-e szilíciumon világító dióda?
IC gyártás Új technológiák. 2 Strained Silicon (laza szilícium)
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke 1. zárthelyi megoldásai október 10.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke Berkeley CMOS tesztábrák Minőségbiztosítás a mikroelektronikában,
Az üzleti rendszer komplex döntési modelljei (Modellekkel, számítógéppel támogatott üzleti tervezés) II. Hanyecz Lajos.
CCD spektrométerek szerepe ma
HARDVER IT ALAPFOGALMAK. NEUMANN-ELVŰ SZÁMÍTÓGÉPEK FELÉPÍTÉSE Központi feldolgozó egység Háttértárolók Adatbeviteli eszközök (Input) Operatív tár (Memória)
1.Határozza meg a kapacitást két párhuzamos A felületű, d távolságú fémlemez között. Hanyagolja el a szélhatásokat, feltételezve, hogy a e lemez pár egy.
1 Termikus-elektromos eszköz a nanoelektronikában Áttekintés VO 2 háttérismeretek Termikus-elektromos eszköz a nanoelektronikában elmélet gyakorlat neuron.
A digitális kompetencia mérése. IKT-alapú értékelés
Fő alkalmazási területek
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke Minőségbiztosítás a mikroelektronikában A monolit technika.
Napelemek laboratórium 1. gyakorlat
6 szigma.
Épületek energiaellátása
Elektronikai technológia
Előadás másolata:

A mikroelektronikai technológia kihívásai Németh Ágoston

Bevezető A miniatürizálás távlatai Problémák rövidtávon (-2007) Problémák hosszú távon (2008-2016)

ITRS (International Technology Roadmap for Semiconductors) USA 1992 ITRS néven nemzetközi szervezet 1998 Célja: meghatározni a félvezetőipar rövid és hosszú távú szükségleteit és kutatni ezek megoldási lehetőségeit Felépítése: 12 nemzetközi munkacsoport, 800 szakértővel

ITRS felépítése

Az ITWG-k fő tématerületei Design (D) Test (T) Process Integration, Devices and Structures (PI, D, S) Front End Process (FEP) Litography (L) Interconnect (I) Factory Integration (FI) Assembly and Packaging (A, P) Environment, Safety and Health (E, S, H) Yield Enchancement (YE) Metrology (M) Modelling and Simulation (M, S)

Az IC szükségletek hierarchiája

Gate-hossz változása

Half Pitch változása

RED BRICK WALL

Rövidtávú kihívások (-2007)

Rövidtávú kihívások

Rövidtávú kihívások Teljesítmény növelés Mos teljesítmény és szivárgás (PI, D, S) Kis teljesítményfelvételű logikáknál (Hordozható eszközök..) fő szempont a kis szivárgási áram az akku élettartam növelése miatt Az eszköz teljesítménye ezzel összhangban nő Szivárgások: Gate szivárgás Sub-threshold és junktion szivárgás Sáv-sáv tunelezés Feladat: nagy  dilelektrikumú gate (~2005)

Rövidtávú kihívások Teljesítmény növelés Nem klasszikus CMOS gyártás (PI, D, S, FEP) A gate hosszúság gyors és hozzá képest lassú gate oxid vastagság scale down körülményessé teszi a hagyományos CMOS scale down-t Új struktúrák kifejlesztésére van szükség (Dupla gate-es MOS, FinFET…) Feladat: Időzítési problémák, technológiába integrálás, minősítés (~2007)

Rövidtávú kihívások Teljesítmény növelés

Rövidtávú kihívások Teljesítmény növelés Új gate struktúrák és anyagok (FEP) A gate hosszúság csökkentése magával kell, hogy hozza a source és drain átmenet mélységek és gate dielektrikum vastagság csökkenését, hogy a teljesítménynövekedés realizálható legyen Jelen helyzetben ez 2nm-es oxidot jelentene ami a szivárgási áram miatt nem lenne praktikus Feladat: Nagy dielektromos állandójú () anyag alkalmazása, és alternatív gate elektróda anyag bevezetése

Rövidtávú kihívások Teljesítmény növelés CMOS integrálás az új memória anyagokhoz és technológiákhoz (FEP) A DRAM scaling-et meghatározza a legkisebb kapacitásérték, ami nem lehet kisebb 25-35 fF-nál Kisebb területű kondenzátorok nagyobb dielektromos állandójú anyag kell. Előre látható, hogy a Silicon-Insulator-Silicon (SIS) struktúrát felváltja a Metal-Insulator-Metal (MIM) struktúra A Flash memóriáknál a beíró feszültség csökkentése a tunel oxid vékonyítását követeli meg. Ami magával hozza az emlékezet rövidülését. Ezzel együtt csökkenteni kell az inter-poly oxid vastagságát, ami megintcsak az emlékezetrövidülést okozza Feladat: új inter-poly és tunel anyagok bevezetése

Rövidtávú kihívások Teljesítmény növelés CD és Leff kontroll (FEP, L) A Critical Dimension (CD) kontrollálása a gate szinten mindig is a legnagyobb kihívások közé tartozott. Új eljárásokkal már lehetőség van a rezisztben előhívott csíkszélességnél kisebb effektív gate hosszúság (Leff) kialakítására Problémát jelet a marási élek beállítása és a marási stop beállítása mielőtt a rendkívül vékony gate oxidon trenchet vágnánk

Rövidtávú kihívások Teljesítmény növelés Technológia kontroll (L) A befedettség és a csíkszélesség kontrollálása is kihívást jelent. Nem eldöntött, hogy a szélesség vastagság milyen aránya ideális. A reziszt vonal érdessége, hogy a gate szélesség megfelelően kontrollálható legyen, egy polimer egység nagyságrendjébe kell, hogy essen Feladat: Teljesen új rendszerű, kompatíbilis, költségkímélő megvilágító berendezés kifejlesztése

Rövidtávú kihívások Teljesítmény növelés

Rövidtávú kihívások Teljesítmény növelés Új eljárások és struktúrák integrálása (I) Új anyagok, eljárások és struktúrák bevezetése tovább növelik a a technológia komplexitását. A kontaktus lyukak és a barrier fém előállításakor kölcsönhatásba kerül a vezetékezés és a szigetelő réteg. Feladat: Olyan technológia kidolgozása, amely a további méretcsökkenés miatt fokozódó fém diffúziót kivédi.

Rövidtávú kihívások Költségkímélő gyártás Power Management (D) A kis teljesítményfelvételű eszközök statikus áramfelvétele 10-szeresére nő technológiai csomópontonként és a nagy teljesítményű MPU disszipációja 15 éven belül 25-szörösére nő, ami a tokozás által szabott határ. Feladat: Olyan Power Management megalkotása, ami rugalmasan kapcsolja az áramkörök tápellátását, alkalmazva multi-Vt, multi-Tox, multi-Vdd megoldásokat

Rövidtávú kihívások Költségkímélő gyártás Nagysebességű eszköz interfészek (T, TE) Egyike a legfőbb redblockoknak az egyre nagyobb frekvenciájú, egyre több mérőtűs tesztberendezések iránti igény Az interfész eszközöknek hasonló csíkszélességűnek és integráltságúnak kell lenni, különösen a nagyfrekvenciás differenciál I/O és analóg áramkörökben, máskülönben zaj keletkezik Feladat: Megfelelő Design-For-Test (DFT) és Design-For-Manufacturing (DFM) kifejlesztése

Rövidtávú kihívások Költségkímélő gyártás Nagy integráltságú tervezés és SoCs (T, TE) A strukturált DFT megköveteli a megfelelően sok hozzáférést a különálló blokkokhoz és a Built-in Self Test (BIST) megfelelő használatához Fő probléma az RF és nagy számú zajos áramköröket tartalmazó tesztchipek alkalmazása Feladat: A teszt interfészek egyszerűsítése és lassú de folyamatos kapacitásbővítése és az analóg DFT és BIST továbbfejlesztése A DTF komplexebb tervezésével lecsökkenteni a tesztidőt

Rövidtávú kihívások Költségkímélő gyártás Berendezés és R&D költségek (L) A fotolitográfia költségei a teljes gyártás költségének jelentős részét teszik ki. Megtérülése fokozható a nagyobb szeletméretek, illetve optikai (193nm és 157nm), vagy új generációs litográfia bevezetésével. Feladat: Új rezisztanyagok kifejlesztése, új lencseanyagok alkalmazása (CaF2, ArF)

Rövidtávú kihívások Költségkímélő gyártás A gyártás fokozódó integráltsága (FI) A félvezetőipar gyors fejlődése és változásai és a piac igényeinek változó alakulása a gyárak nagy komplexitását, integráltságát és rugalmasságát kívánja meg. Leginkább fejlődő ágak 157nm litográfia High κ gate stack, low κ dielektrics SOI, réz vezetékezés Feladat: Fejlettebb termelésirányító rendszerek és szoftverek bevezetése, gyorsan és hatékonyan fejleszthető termelés kialakítása.

Rövidtávú kihívások Költségkímélő gyártás Chip, tokozás és alapanyag szmulációs eszközök (AP) A folyamatos fejlődés, a kisebb feszültség, nagyobb teljesítménysűrűség, nagyobb frekvencia, A és D jelek integrálása a tokozás gyors fejlődését követeli meg, máskülönben a tokozás szűk keresztmetszetté válhat. Feladat: Szimulációs eszköz fejlesztése, ami figyelembe veszi az elektromos karakterisztikát, a termikus disszipációt, a feszültségeket, fizikai és környezeti kívánalmakat, és ezek alapján megfelelő tokozások tervezése

Rövidtávú kihívások Költségkímélő gyártás Ellenőrzés (YE) A via és csíkszélesség csökkenéssel a hibakeresés egyre nehézkesebbé válik. A felszín alatti és ahhoz közeli hibák kiszűrése egyike a legnagyobb kihívásoknak. A kihozatal növelése érdekében a hibakeresésnek gyorsabbnak és pontosabbnak kell lenni. Feladat: Nagysebességű költségkímélő hibadetektálás kifejlesztése.

Rövidtávú kihívások Költségkímélő gyártás Nem vizuális hibakeresés és gyártás és tesztorientált tervezés (YE) Az IC gyártás során sok olyan hiba is keletkezhet, ami a vizuális hibakeresés számára láthatatlan. Sok ezek közül a gyártósoron nem diagnosztizálható. Feladat: Olyan tesztelő és hibakereső berendezés építése ami az optimális kihozatalt biztosítja.

Rövidtávú kihívások Költségkímélő gyártás Új eszközök időszerű bevezetése (M) Gyorsuló ütemben jelennek meg új anyagok, technológiák, mérettartományok és struktúrák. Ezek nem mindegyikét érdemes bevezetni, de fejlettebb technológiával kisebb mérettartományokban és nagyobb szeletátmérővel dolgozni kisebb egységköltséget jelent. Feladat: Rugalmasan és időszerűen bevezetni az új eljárásokat

Rövidtávú kihívások Költségkímélő gyártás Hatékony 300mm átállás (FI) Berendezések, anyagok jobb kihasználása (FI) Anyagok és vegyszerek (ESH) Források konzerválása (ESH) Komplex struktúrák mérése (M) Maszk készítés (L)

Hosszú távú kihívások (2008-2016)

Hosszú távú kihívások

Hosszútávú kihívások Teljesítmény növelés Nem CMOS eszközök bevezetése (PI, D, S) Hosszútávon a méretcsökkentés eléri a CMOS eszközök elvi alsó határát is. Ez előrevetíti annak a lehetőségét, hogy új, nem CMOS alapú eszközök jelennek meg. Feladat: A nem CMOS alapú eszközök integrálása CMOS eszközökkel.

Hosszútávú kihívások Teljesítmény növelés Új generációs litográfia (L) Az optikai litográfia a 45nm-es technológiai csomópontig működhet csak. Ezután más rendszerű litográfiai lejárásokat kell bevezetni. Az extrém UV (EUV) és az elektron vetítéses litográfia (EPL) alkalmazása lehetséges, de költségeik egyenlőre nagyon magasak. Feladat: Az új generációs litográfia által megkövetelt teljesen új infrastruktúra megteremtése

Hosszútávú kihívások Teljesítmény növelés Összeköttetések (I) Hagyományos összeköttetéseket a 2010-es évekre elért mérettartományokban már nem lehet alkalmazni. Itt már sem a réz, sem a kis κ-jú anyagok nem jelentenek megoldást. Feladat: Anyagkutatások és nem konvencionális huzalozástervezés szükséges. Tervezni kell az új struktúrákban az időzítésekkel és jelhosszakkal is.

Hosszútávú kihívások Költségkímélő gyártás Zaj (D) A technológiai csomópontonként 20%-os tápfeszültség csökkentés a zaj problémáját kritikussá teszi ezekre az évekre. Feladat: A tervezés minden fázisára kiterjedő szimulációra és analízisre van szükség

Hosszútávú kihívások Költségkímélő gyártás Hibatűrő tervezés (D) A megengedhető hibák száma a tranzisztor méretcsökkenésével és a bonyolultság növekedésével csökken. Feladat: self-correcting/self-repairing áramkörök és on-chip újrakonfigurálás lehetőségének megteremtése

Hosszútávú kihívások Költségkímélő gyártás Alapanyag 300mm felett (FEP) A szeletátmérő az eddigi hagyományok szerint 1,5-szeresére változott, míg a terület 2,25-szörösére. Ez a most alkalmazott 300mm-es szeletekhez képest a 450mm-es szeletek bevezetését követelné meg. Nem egyértelmű még, hogy a hagyományos Czochralski húzással előállítható e ekkora méret. Feladat: Megtalálni a módját a 450mm-es szeletek előállításának

Hosszútávú kihívások Költségkímélő gyártás

Hosszútávú kihívások Költségkímélő gyártás Roncsolásmentes mérések (M) A felületi töltések és az elektronsugár az elektronsugaras képalkotásnál károsan hatnak kölcsön. A 3D struktúrák és kritikus méretek mérésére egyre inkább szükség van Feladat: roncsolásmentes mérési és minősítési eljárások kidolgozása

Hosszútávú kihívások Költségkímélő gyártás CMOS szimuláció (MS) Az eszközök zsugorodása a szimulációnál figyelembe veendő fizikai és kémiai hatások számát megnöveli. Feladat: Mindenre kiterjedő modell felállítása (atomi erők, hibrid quantum eszközök (2D/3D) leírása…)

Hosszútávú kihívások Költségkímélő gyártás Bulk CMOS és 450mm gyártási paradigmák (FI) Vegyi- és alapanyag menedzsment (ESH) Új anyagok és eszközök integrálhatóságának modellezése(YE)