Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.

Slides:



Advertisements
Hasonló előadás
LILI MARLEEN Lale Andersen :
Advertisements

Rendek tanya Állattenyésztés
Módbeli segédigék Készítette: Szántai Gábor
HERBST. Rainer Maria Rilke ( )
Anikó Fekete Németország Deutschland 2013.feb. 18-márc.20.
Digitális elektronika
Logikai alapkapcsolások
Az integrált áramkörökben (IC-kben) használatos alapáramkörök
MIKROELEKTRONIKA, VIEEA306
Kovalens kötés a szilícium-kristályrácsban
MOS integrált áramkörök Mikroelektronika és Technológia BME Elektronikus Eszközök Tanszéke 1999 október.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke IC layout tervek tesztelése.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke IC layout tervek tesztelése.
Cim Design flow, production flow, maszkok, technológia Tervezési szabályok, lambda. Pálcika diagram, alap layoutok1Fa03.27 P Layout tervezés, P&R1Fa03.30.
MIKROELEKTRONIKA, VIEEA306
MIKROELEKTRONIKA, VIEEA306
MIKROELEKTRONIKA, VIEEA306
MIKROELEKTRONIKA, VIEEA306
Monolit technika MOS technológia Mizsei János Hodossy Sándor BME-EET
Cim Design flow, production flow, maszkok, technológia Tervezési szabályok, lambda. Pálcika diagram, alap layoutok Layout tervezés, P&R.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA306 MOS áramkörök: CMOS áramkörök,
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA306 A bipoláris IC technológia.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA306 Integrált áramkörök: áttekintés,
MIKROELEKTRONIKA, VIEEA306
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke 2. zárthelyi megoldásai december 2.
Luft, Wasser, Boden _ Levegő, víz, föld. Luft – Levegő.
MIKROELEKTRONIKA, VIEEA306
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke Zárthelyi előkészítés október 10.
Záhonyt a páneuropai 5-ik és 7-ik közlekedési folyósó is érinti Bei Záhony treffen der 5. und die 6. Paneuropäische Korridor zusammen.
Frazémák kontrasztív vizsgálata a kultúrák találkozásakor
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA /2009 I. félév Követlemények.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA /2012 I. félév Követelmények.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA /2013 I. félév Követelmények.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke MIKROELEKTRONIKA, VIEEA /2011 I. félév Követelmények.
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke Mikroelektronika Laboratórium Tájékoztató
MIKROELEKTRONIKA, VIEEA306
Budapesti Műszaki és Gazdaságtudományi Egyetem Elektronikus Eszközök Tanszéke Termikus hatások analóg integrált áramkörökben Esettanulmány:
Mehrabschnitts-Signalisierung
Signalisierung Rangierfahrten. Vonat- és tolatómenetek Megkülönböztetés –szigorú –lazább (pl. francia) –nincs (pl. holland) Tolatásjelzők érvényessége.
Nagy benyomást kelt ő reklámfotók*** Ausdrucksstarke Werbefotos.
Ungarische Literatur während des Ersten Weltkriegs Endre Ady, Erinnerung an eine Sommernacht Mihály Babits, Vor Ostern Ágnes Csikai, Zsuzsanna Mészáros,
1 1 der Adventskranz, -¨e adventi koszorú der Adventskranz, -¨e adventi koszorú Einen klassischen Adventskranz aus Tannengrün kann man auch beim Gärtner.
Igeidők és jelentéseik, egyidejűség, előidejűség és utóidejűség
Ich und der Computer und natürlich das
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
ÜBER UNSERE FIRMAUNSER MASCHINENPARKUNSERE REFERENZEN ANSCHRIFT UNSERE PRODUKTEQUALITÄT VM-Form Kft. Vaspálya u.54, H-1103 Budapest, UNGARN Tel:
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.
Ungarnconsulting_Markteintritt in Ungarn
Folie 1 Roland Ackermann/DP-TP PneuPos Pneumatikus pozícionálás.
Einladung Meghívó. Orosháza Város Német Nemzetiségi Önkormányzata.
Moderne Stähle Ausgewählte Kapitel aus der Materialwissenschaft MSc Präsentation Széchenyi István Universität Dr. Zsoldos Ibolya.
Információ átadás az idegrendszerben és a társadalomban (gondolatok)
0. Kiejtés A) Magánhangzók: a: á: Ball, alt, acht, Abend, au: áu: auch, blau, aus, Urlaub ai: áj: Mai, bayrisch ä: nyílt e: länger, Blätter, älter, hässlich.
2. Erste Kontakte 1. A Első beszélgetés („tegező” formában)
Das älteste Auto der Welt und funktionstüchtig ist Französisch
JUMP: Literaturhinweise Book recommendations
25. Vorlesung Die Mentalhygienie
MIKROELEKTRONIKA, VIEEA306
Das älteste Auto der Welt und funktionstüchtig ist Französisch
Valamikor Chesterfieldben, Midway u
Egy nemzetközi termék és a termékfejlesztés kapcsolata
Gemeindewohnung Studentenaktion.
MOS technológia Mizsei János Hodossy Sándor BME-EET
Johann Wolfgang von Goethe: Rád gondolok
MIKROELEKTRONIK, VIEEAB00
DENGLISCH Dóra Szeles Pannonishe Universität, Veszprém.
Előadás másolata:

Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00 MOS Schaltkreise: CMOS Schaltungen, Konstruktionsfragen

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Untersuchte Abstraktionsebene SYSTEM BLOCK (MODULE) + GATTER (GATE) SCHALTKREIS (CIRCUIT) n+ SD G BAUSTEIN (DEVICE) V out V in

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Der CMOS Inverter V DD GND AUS EIN n p V DD GND AUS=0 EIN=1 V DD GND AUS=1 EIN=0 Im stationären Zustand wird immer nur der eine von beiden Transistoren leiten, der andere ist gesperrt.

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Versionen, abhängig von der Versorgungsspannung und von der Schwellspannung der Transistoren 1. Niedrige V DD : V DD < V Tn + |V Tp | Nur einer der Transistoren leitet 2. höhere V DD : V DD > V Tn + |V Tp | Beim Umschalten leiten beide Transistoren gleichzeitig U EIN U V Tn V V Tp V DD V Obere Transistor leitet 0 0 Untere Transistor leitet Obere Transistor V Tp leitet Untere Transistor leitet Die Charakteristik des CMOS Inverters EINAUS

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Die Charakteristik des CMOS Inverters ► 1. Niedrige Versorgungsspannung: V DD < V Tn + |V Tp | die Charakteristik: = KI 0 U < TnBE VUwenn << TpDDBETn VVUV wenn unbestimmt, -> TpDDBE VVUwenn V DD U EIN V Tn V DD -V-V Tp V DD V U AUS unbestimmt V DD U EIN V DD -V-V Tp V DD U AUS V Tn Der mittlere Teil der transfer Charakteristik ist sehr steil, das ist ein typischer Vorteil des CMOS Inverters.

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Die Charakteristik des CMOS Inverters ► 2. Hohe Versorgungsspannung: V DD > V Tn + |V Tp | Beim Umschalten ? - “Kurzschluss-Strom" ► Konstruktion der Charakteristik Kanal EIN AUS

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Bedingungen für symmetrischen Betrieb: Wenn U BE =U K (Umschaltschwelle), sind die Ströme der beiden Tran- sistoren gleich: U GSp =V DD -U K U GSn =U K Der CMOS Inverter Die Umschaltschwelle U K hängt von dem Verhältnis der Stromkonstanten der Transistoren ab. Wenn V Tn =|V Tp |, und U K =V DD /2 wird gesucht, dann soll K n =K p gewählt werden. weil die Beweglichkeit der Löcher ist ca x kleiner (siehe: Koll.Heft Elektronik) Die Umschaltschwelle kann mit den Verhältnissen W/L eingestellt werden

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Der CMOS Inverter – dynamische Char. ► Berechnung der Schaltzeiten  Vovon hängen sie ab? von der Stromtreibungsfähigkeit des Ausgangs von der kapazitiven Last am Ausgang ► Wenn die Transistoren genau komplementäre Charakteristiken aufweisen, sind dann auch die Schaltzeiten (Anstieg und Fall) gleich (K n =K p und V Tn =|V Tp |) AUS U AUS

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Kapazitäten: ► Die internen Kapazitäten der Treiberstufen ► Eingangskapazitäten der Transistoren der Folgestufen ► Kapazitäten der Verbindungsleitungen V out1 V in M2M2 M1M1 M4M4 M3M3 V out2 C DB2 C DB1 C GD12 intrinsic MOS transistor capacitances C G4 C G3 extrinsic MOS transistor (fanout) capacitances CwCw wiring (interconnect) capacitance

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Kapazitäten: ► Die internen Kapazitäten wurden schon betrachtet:  S-G G-D Überlappungskapazitäten  die Kapazität des Kanals  die Kapazitäten der pn Übergänge ► Die Leitungskapazitäten  hängen von der Geometrie der Leitungen ab (Länge, Weite)  ihre Bedeutung wächst als sich die Technologie entwickelt Siehe später!

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Der CMOS Inverter – dynamische Char. ► Berechnung der Schaltzeiten  gleiche Schaltzeiten, Integration für die extremen Spannungswerte der Kapazität: V LM – minimale Spannung an C L  Wenn dann t l kann durch Erhöhung der Versorgungsspannung oder W/L reduziert werden.

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Leistungsverbrauch des CMOS Inverters ► Kein statischer Verbrauch, weil kein statischer Strom ► Der dynamische Verbrauch beim Umschalten besteht aus zwei Teilen:  Kurzschluss-Strom: Während eines Teils der Umschaltflanke leiten beide Transistoren, wenn V Tn <U BE <V DD -V Tp  Ladung-Pumpen: Beim Umschalten zu 1 lädt der p-Transistor die Last C L bis V DD auf, und beim Umschalten zu 0 entlädt der n-Transistor sie bis Null. Ladung wird gepumpt von der Versorgung zum Grund.

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Leistungsverbrauch des CMOS Inverters ► Kurzschluss-Strom: Während eines Teils der Umschaltflanke leiten beide Transistoren, wenn V Tn <U BE <V DD -V Tp die Ladung ist:, wo t UD ist die Dauer des Strom- impulses, b ist eine Formkonstante des Umschaltsignals. b  P ~ f V DD 3

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Leistungsverbrauch des CMOS Inverters ► Ladung-Pumpen: Beim Umschalten zu 1 lädt der p-Transistor die Last C L bis V DD auf, und beim Umschalten zu 0 entlädt der n-Transistor sie bis Null. P cp =f C L V DD 2 Der Leistungsbedarf des Ladung-Pumpens ist proportional der Frequenz und dem Quadrat der Versorgungsspannung. ► Der Totalverbrauch ist die Summe von beiden (wenn Kurzschlussstrom auch auftritt), er ist proportional der Frequenz und der zweiten, bzw. dritten Potenz der Versorgungsspannung.

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Komponenten des Leistungsverbrauchs der CMOS Schaltkreise ► Dynamische Komponenten – bei jeder Umschaltung  Kurzschlussstrom, Ladung-Pumpen  proportional der Ereignishäufigkeit Taktfrequenz Aktivität des Schaltkreises ► Weitere Komponenten wegen parasitärer Effekte:  Unterschwellströme  Leckströme von pn Übergängen – leakage: heute schon erheblich  Leckage durch das Dielektrikum des Gates

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Konstruktionsfragen ► Konstruktion von CMOS Gattern ► Herstellung (Überschau der poly-Si Gate Technologie) ► Layout

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET  beide kombiniert: komplex Gatter CMOS Gatter ► Konstruktion von nMOS Schalternetz: ► Anstelle Schalter: nMOS Transistoren ► anstelle Load: das Duale des nMOS Schaltnetzes aus pMOS Transistoren  serieller Strompfad: NAND Verknüpfung  paralleler Strompfad: NOR Verknüpfung

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET ► Im CMOS Inverter werden beide Transistoren gesteuert. ► Bei Gatter erscheinen je ein „oberer" (pMOS) und ein „unterer" (nMOS) Netzwerk, beide bestehen aus soviel Transistoren wie die Funktion Eingänge hat.  Bei jenen Eingangskombinationen, wo der Ausgang 0 ist, bildet das untere Netzwerk einen Kurzschluss zwischen dem Ausgang und dem Grund, während das obere Netzwerk zwischen dem Ausgang und der Versorgung gebrochen ist.  Wenn der Ausgangswert 1 ist, dann ist das untere Netzwerk gebrochen, und dafür bildet der obere einen Kurzschluss Mit den p- bzw. n-Transistoren sollen duale Netzwerke realisiert werden. ► Gates mit demselben Eingangssignal sollen miteinander verbunden werden. CMOS Gatter

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET CMOS Gatter ► NOR Gatter ► NAND Gatter Für ein Gatter mit n Eingängen sind 2n Transistoren notwendig. (passzív terhelésű kapuknál csak n+1 kell)

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Konstruktion von CMOS Gattern ► duale Topologie (aus Schleife Knotenpunkt, aus Knotenpunkt Schleife) ► duale Komponenten: pMOS statt nMOS ► Gates mit demselben Eingangssignal sollen miteinander verbunden werden. ► geeignete Dimensionierung der W/L Verhältnisse BCAF 

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Untersuchte Abstraktionsebene SYSTEM BLOCK (MODULE) + GATTER (GATE) SCHALTKREIS (CIRCUIT) n+ SD G BAUSTEIN (DEVICE) V out V in

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Layout eines Verarmungs-Inverters ► Layout = Die Gesamtheit der 2D-Gebilde auf der Maskenfolge ► Einer jeden Maske wird ein Farbenkode geordnet:  Aktivbereich: rot  poly-Si: grün  Kontakte:schwarz  Metall:blau ► Maske = Layout-Ebene S G D S G D Wo gibt es Transistor? Wo zwischen dotierten Bereichen sich ein Kanal bilden kann. CHANNEL = ACTIVE AND POLY

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Si-Compiler ► Logische Schema oder Beschreibung auf hoher Ebene ► Schaltplan auf Transistor-Ebene mit W/L Daten ► Layout mit Stick-Diagramm ► Vollständiges Layout  automatische Konversion zwischen den Beschreibungs- formen  HARDWARE-SYNTHESE 1.Von Verhaltensbeschreibung in Strukturelle 2.Realisierung von strukturellen Beschreibung in gegebener Technologie: technology mapping Jetzt wurden die Grundlagen der Realisierung in IC- Form vorgestellt Es ist auch in FPGA-Form möglich

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Layout eines CMOS Inverters p Wanne n Wanne

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Vereinfachtes Layout: Stick diagram aktíve Zone Poly Metall Kontakt Vdd Out In GND In Out W/L Verhältnisse sind gegeben 2/2

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Layout Primitiven: einfache Gebilde Gate (Maske der poly-Si Musterung) Kontakte (Fenstermaske im Feldoxyd) S/D Anschlüsse (Maske der Metallisierung) Aktíve Zone (Fenstermaske im Dünnoxyd)

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Layout eines nMOS Transistors: Layout Primitiven auf echten Layoutschichten Layout eines nMOS Transistors + Umrisslinie + Anschlüsse (Pins) Makro eines nMOS Transistors: Umriss, Anschlüsse, Beschriftungen: auf Pseudoschichten nMOS D S G G Layout Makros – aus Primitiven

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Layout Makros – aus Makros und Primitiven nMOS D S G G pMOSDS G G Layout auf Gatterebene

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET n+ p-Si Substrat n Wanne p+ CMOS Struktur (Inverter)

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET ► Zusätzliche Masken:  n-Wanne (oder p-Wanne, je nach Substrat-Typ)  P-Diffusion (oder n-Diffusion, je nach Substrat-Typ) ► CMOS mit mehreren Metallschichten:  eine eigene Maske für eine jede Metallschicht,  Kontakte, Vias ► Mehrere Polyschichten sind möglich (analog CMOS) ► Typisch: Masken ► Für die Machbarkeit sind Regeln einzuhalten: Entwurfsregeln (Design Rules, DRC)  diese folgen von der Technologie, gegeben vom IC- Hersteller CMOS Strukturen

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Ausschnitt eines CMOS layouts INV NAND3 Die Schaltung kann vom Layout wiederhergestellt werden: Prüfung, realistische Verzögerungen nur 2 Metallschichten

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Moderne Verbindungstechnik

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Beispiel: Intel 0.25 μm Technologie 5 metal layers Ti/Al - Cu/Ti/TiN Polysilicon dielectric

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Kapazitäten der Leitungen Elektrische Feldlinien W H t di Dielektrikum (SiO 2 ) Substrat C pp = (  di /t di ) WL Stromrichtung Dielektrizitäts- konstante (SiO 2 => 3.9) L Parallele Elektroden: parallel plate capacitance

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Kapazitäten der Leitungen interwire fringe pp C wire = C pp + C fringe + C interwire = (  di /t di )WL + (2  di )/log(t di /H) + (  di /t di )HL parallele Platte Rand- kapazität Kapazität zwischen Leitungen H

Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke CMOS áramkörök, konstrukciós kérdések © Poppe András, BME-EET Weitere Effekte bei Leitungen ► Widerstand ► RC Leitungen von verteilten Parametern Diffusionsgleichung