Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00.

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1 http://www.eet.bme.hu Technische und Wirtschaftswissenschaftliche Universität Budapest Lehrstuhl für Elektronische Bauelemente MIKROELEKTRONIK, VIEEAB00 MOS Inverter http://www.eet.bme.hu/~gaertner/Vorlesungen/FET2Inverter.ppt

2 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 2 Untersuchte Abstraktionsebene SYSTEM BLOCK (MODULE) + GATTER (GATE) SCHALTKREIS (CIRCUIT) n+ SD G BAUSTEIN (DEVICE) V out V in

3 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 3 Arbeitsweise der MOSFETs ► Das einfachste (logische) Modell der Funktion:  Nicht leitet (off) / leitet (on) Gate Source (of carriers) Drain (of carriers) | V GS | | V GS | < | V T | | V GS | > | V T | Open (off) (Gate = ‘0’) Closed (on) (Gate = ‘1’) R on offen leitet Anreicherungstyp

4 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 4 Ein Inverter wird gebaut – das ist der Start ► Ein Resistor, an V DD angeschlossen ► Die andere Klemme wird durch einen Schalter an die Masse (GND) angeschlossen ► Der Schalter wird mit Logiksignal angesteuert:  1 (V DD ) – leitet  0 (GND ) – unterbrochen ► Das Ausgangssignal wird von der gemeinsamer Klemme des Widerstands und des Schalters genommen V DD GND EIN AUS load (Last- widerstand)

5 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 5 Prinzipielle Inverterschaltungen V DD GND EIN AUS Schalter = n-Kanal MOS Transistor: normally OFF device V DD GND EIN AUS Widerstand: ein anderer Transistor, z.B. in Triodenbereich V DD GND EIN AUS V GG zusätzliche Versorgung – not OK load drive

6 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 6 nMOS-Technik – sehr einfach ► Einfache Technologie, aber überholt, mit Nachteilen, z.B.  statischer Verbrauch bei AUS=0  der logische 0 liegt nicht am sauberen GND-Niveau  asymmetrischer Transfer- Charakteristik EIN ► In beiden Fällen wurde an Stelle des Widerstands load ein MOS Transistor verwendet, aber ohne aktive Steuerung.  Das ist ein Inverter mit passivem load. Verarmungstyp: durch Implantation verschobene V T V DD GND AUS I d ~ W/L

7 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 7 Die CMOS-Technik ► Der Name: Complementary MOS ► Die Idee: auch der load soll aktiv gesteuert werden  wenn der nMOS driver (Schalter) Transistor leitet (on), soll der load Transistor gesperrt (off) sein  wenn der nMOS driver (Schalter) Transistor gesperrt (off) ist, soll der load Transistor leiten (on) ► Dazu wird ein normally OFF device gebraucht, das gegenüber dem nMOS Transistor eine umgekehrte Steuerfunktion aufweist.  Dafür ist ein Anreicherungs-pMOS Transistor geeignet.

8 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 8 Der CMOS Inverter V DD GND AUS EIN n p V DD GND AUS=0 EIN=1 V DD GND AUS=1 EIN=0 Im stationären Zustand wird immer nur der eine von beiden Transistoren leiten, der andere ist gesperrt.

9 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 9 2 Versionen, abhängig von der Versorgungsspannung und von der Schwellspannung der Transistoren 1. Niedrige V DD : V DD < V Tn + |V Tp | Nur einer der Transistoren leitet 2. höhere V DD : V DD > V Tn + |V Tp | Beim Umschalten leiten beide Transistoren gleichzeitig U EIN V Tn V Tp V DD Obere Transistor leitet 0 Untere Transistor leitet Obere U EIN V Tn V DD 0 Transistor V Tp leitet Untere Transistor leitet Die Charakteristik des CMOS Inverters EIN AUS

10 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 10 Die Charakteristik des CMOS Inverters ► 1. Niedrige Versorgungsspannung: V DD < V Tn + |V Tp | U EIN V Tn V DD unbestimmt Der mittlere Teil der transfer Charakteristik ist unbestimmt (logisch HZ) weil dort kein Transistor leitet. V DD -V Tp die Charakteristik: = AUS V DD U U EIN > V Tn wenn.............. wennunbestimmt, U EIN < V DD - V TP wenn............ 0 U AUS V DD - V TP < U EIN < V Tn

11 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 11 Die Charakteristik des CMOS Inverters ► 2. Hohe Versorgungsspannung: V DD > V Tn + |V Tp | Beim Umschalten ? - “Kurzschluss-Strom" ► Konstruktion der Charakteristik Kanal EIN AUS

12 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 12 Bedingungen für symmetrischen Betrieb: Wenn U EIN =U K (Umschaltschwelle), sind die Ströme der beiden Tran- sistoren gleich: U GSp =V DD -U K U GSn =U K Der CMOS Inverter Die Umschaltschwelle U K hängt von dem Verhältnis der Stromkonstanten der Transistoren ab. Wenn V Tn =|V Tp |, und U K =V DD /2 wird gesucht, dann soll K n =K p gewählt werden. weil die Beweglichkeit der Löcher ca. 2... 2.5x kleiner ist (siehe: Koll.Heft Elektronik) Die Umschaltschwelle kann mit den Verhältnissen W/L eingestellt werden

13 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 13 Grundlagen vom Inverter ► Transfer Charakteristik:  Ausgangsspannung in Abhängigkeit von der Eingangsspannung Das Ausgangssignal ist das (logische) invertierte des Eingangssignals Transfer Charakteristik des idealen und realen Inverters Der mittlere Teil der transfer Charakteristik ist sehr steil, das ist ein typischer Vorteil des CMOS Inverters.

14 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 14 Grundlagen vom Inverter ► Störsicherheit:  Ein stabiler U out Wert gehört zu einem breiten U in Bereich  Die Charakteristik besteht aus 3 Teilen.  Die beiden Randbereiche sind flach, d.h. die Änderun- gen der Eingangsspannung bringen nur eine sehr kleine Änderung am Ausgang Transfer Charakteristik des idealen und realen Inverters L und H Bereiche L H

15 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 15 Grundlagen vom Inverter ► Signalregenerierungsfähigkeit  sie hängt von der Steilheit des mittleren Teils ab. U 1 ist ein “falsches" logisches 0. U 2 am Ausgang des ersten Gatters liegt schon näher dem Pegel eines akzeptablen logischen 1. U3 am Ausgang des zweiten Gatters ist schon ein “gutes" logisches 0. 1 1 U 1 U 2 U 3 U in U out “1” “0” U1U1 U2U2 U 2 U3 U3 Transfer Charakteristik des idealen und realen Inverters

16 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 16 Grundlagen vom Inverter ► Signalregenerierungsfähigkeit U3U3 U2U2 U1U1 0.0n10.0n20.0n30.0n40.0n time [sec] -0.0 1.0 2.0 3.0 4.0 5.0 6.0 U [V] Eindeutig: sowohl der Pegel, als auch das Signalform von U 3 ist regeneriert worden! U L =0V, U H =5V (SPICE Simulation) 1 1 U 1 U 2 U 3

17 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 17 Grundlagen vom Inverter ► Schaltschwelle Die Grenze für Signalregenerie- rung in Richtung 0 oder 1 bei einer Inverterkette. Schnittpunkt der Gerade U in =U out und der Charakteristik U in U out V dd UkUk U in = U out

18 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 18 Grundlagen vom Inverter ► Logische Pegelbereiche Jene Spannungsbereiche für logisch 0 und 1, innerhalb derer die Schaltung bei gegebenen Störsignalpegel störfrei funktioniert. Kritische Spannungen: U LM, das Maximum der logischen 0 U Hm, das Minimum der logischen 1 U in U out V dd UkUk U Hm UZUZ U LM BEISPIEL: 74HC00, V dd =3V, U LM =0.9V U Hm =2.1V

19 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 19 Grundlagen vom Inverter ► Laufzeit (propagation delay) t pd ist nicht einfach zu definieren, zumal können die Werte für die steigenden und fallenden Flanken unterschiedlich sein. (z.B. nMOS Inverter)

20 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 20 Grundlagen vom Inverter ► Paarlaufzeit Angenommen, das Signal läuft entlang einer langen Inverterkette aus identischen Elementen. Nach genügend vielen Elementen wird die Signalform nur noch von den internen Eigenschaften der Inverter bestimmt. Die Signalform ist nach zwei Invertern identisch, und die Laufzeit ist t pdp t pdp t UUnUn U n+2 111 nn+2 prop.-delay-paar

21 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 21 Grundlagen vom Inverter ► Die Bestimmung der Paarlaufzeit Der RINGOSZILLATOR Eine ungerade Anzahl von Invertern in einer Kette, hat keinen stabilen Zustand, oszilliert. 11111 T = n  t pdp

22 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 22 Der CMOS Inverter – dynamische Char. ► Berechnung der Schaltzeiten  Vovon hängen sie ab? von der Stromtreibungsfähigkeit des Ausgangs von der kapazitiven Last am Ausgang ► Wenn die Transistoren genau komplementäre Charakteristiken aufweisen, sind dann auch die Schaltzeiten (Anstieg und Fall) gleich (K n =K p und V Tn =|V Tp |) AUS U AUS

23 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 23 Kapazitäten: ► Die internen Kapazitäten der Treiberstufen ► Eingangskapazitäten der Transistoren der Folgestufen ► Kapazitäten der Verbindungsleitungen V out1 V in M2M2 M1M1 M4M4 M3M3 V out2 C DB2 C DB1 C GD12 intrinsic MOS transistor capacitances C G4 C G3 extrinsic MOS transistor (fanout) capacitances CwCw wiring (interconnect) capacitance

24 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 24 Kapazitäten: ► Die internen Kapazitäten wurden schon betrachtet:  S-G G-D Überlappungskapazitäten  die Kapazität des Kanals  die Kapazitäten der pn Übergänge ► Die Leitungskapazitäten  hängen von der Geometrie der Leitungen ab (Länge, Weite)  ihre Bedeutung wächst als sich die Technologie entwickelt Siehe später!

25 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 25 Der CMOS Inverter – dynamische Char. ► Berechnung der Schaltzeiten  gleiche Schaltzeiten, Integration für die extremen Spannungswerte der Kapazität: V LM – minimale Spannung an C L  Wenn dann t l kann durch Erhöhung der Versorgungsspannung oder W/L reduziert werden.

26 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 26 ► Kein statischer Verbrauch, weil kein statischer Strom ► Der dynamische Verbrauch beim Umschalten besteht aus zwei Teilen:  Kurzschluss-Strom: Während eines Teils der Umschaltflanke leiten beide Transistoren, wenn V Tn < U EIN < V DD - V Tp  Ladung-Pumpen: Beim Umschalten zu 1 lädt der p-Transistor die Last C L bis V DD auf, und beim Umschalten zu 0 entlädt der n-Transistor sie bis Null. Ladung wird gepumpt von der Versorgung zum Grund. Leistungsverbrauch des CMOS Inverters

27 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 27 Leistungsverbrauch des CMOS Inverters ► Kurzschluss-Strom: Während eines Teils der Umschaltflanke leiten beide Transistoren, wenn V Tn < U EIN < V DD - V Tp die Ladung ist:, wo t UD die Dauer des Stromimpul- ses, und b eine Formkonstante des Umschaltsignals ist. b  0.1-0.2 P ~ f V DD 3

28 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 28 Leistungsverbrauch des CMOS Inverters ► Ladung-Pumpen: Beim Umschalten zu 1 lädt der p-Transistor die Last C L bis V DD auf, und beim Umschalten zu 0 entlädt der n-Transistor sie bis Null. P cp =f C L V DD 2 Der Leistungsbedarf des Ladung-Pumpens ist proportional der Frequenz und dem Quadrat der Versorgungsspannung. ► Der Totalverbrauch ist die Summe von beiden (wenn Kurzschlussstrom auch auftritt), er ist proportional der Frequenz und der zweiten, bzw. dritten Potenz der Versorgungsspannung.

29 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 29 Komponenten des Leistungsverbrauchs der CMOS Schaltkreise ► Dynamische Komponenten – bei jeder Umschaltung  Kurzschlussstrom, Ladung-Pumpen  proportional der Ereignishäufigkeit Taktfrequenz Aktivität des Schaltkreises ► Weitere Komponenten wegen parasitärer Effekte:  Unterschwellströme  Leckströme von pn Übergängen – leakage: heute schon erheblich  Leckage durch das Dielektrikum des Gates

30 Budapesti Műszaki és Gazdaságtudomanyi Egyetem Elektronikus Eszközök Tanszéke 22.02.2016 A MOS inverterek © Poppe András & Székely Vladimír, PG. BME-EET 2008-2016 30 Grundlagen vom Inverter ► Power-delay-Produkt – Produkt von Gatterlaufzeit und Verlustleistung (P  )  Beide Werte deuten auf bessere Qualität, so das Produkt wird als Qualitätsmerkmal des Schaltkreistyps betrachtet.  Anschaulich: die minimale Energie, benötigt für einen Bearbeitungsschritt von 1 Bit Information.